J. Korean Inst. Electromagn. Eng. Sci. 2023; 34(11):791-798

pISSN: 1226-3133, eISSN: 2288-226X

DOI: https://doi.org/10.5515/KJKIEES.2023.34.11.791

논문/REGULAR PAPERS

Out-Phased Current Combining 방식과 Complex Combining Load 방식을 이용한 3.7~4.0 GHz 대역 GaN-HEMT Doherty 전력증폭기

최재혁https://orcid.org/0000-0002-4835-0400, 진일비https://orcid.org/0000-0003-2030-3351, 김성형https://orcid.org/0009-0004-4973-4360, 송재성https://orcid.org/0009-0009-4095-7687, 이윤정https://orcid.org/0009-0001-7373-6065, 임서균https://orcid.org/0009-0009-1456-6009, 양영구†https://orcid.org/0000-0003-3463-0687
3.7~4.0 GHz GaN-HEMT Doherty Power Amplifier Using Out-Phased Current Combining and Complex Combining Load Methods
Jaehyuk Choihttps://orcid.org/0000-0002-4835-0400, Yifei Chenhttps://orcid.org/0000-0003-2030-3351, Seong-Hyoung Kimhttps://orcid.org/0009-0004-4973-4360, Jaeseong Songhttps://orcid.org/0009-0009-4095-7687, Yoonjung Leehttps://orcid.org/0009-0001-7373-6065, Seogyun Limhttps://orcid.org/0009-0009-1456-6009, Youngoo Yang†https://orcid.org/0000-0003-3463-0687
Author Information & Copyright ▼
성균관대학교 전자전기컴퓨터공학과
Department of Electrical and Computer Engineering, Sungkyunkwan University
†Corresponding Author: Youngoo Yang (e-mail: yang09@skku.edu)

© Copyright 2023 The Korean Institute of Electromagnetic Engineering and Science. This is an Open-Access article distributed under the terms of the Creative Commons Attribution Non-Commercial License (http://creativecommons.org/licenses/by-nc/4.0/) which permits unrestricted non-commercial use, distribution, and reproduction in any medium, provided the original work is properly cited.

Received: Sep 27, 2023; Revised: Oct 16, 2023; Accepted: Oct 24, 2023

Published Online: Nov 30, 2023

요 약

본 논문은 OCC(out-phased current combining)와 CCL(complex combining load)을 함께 적용하여 확장된 OBO(output power back-off)를 가지는 DPA(Doherty power amplifier)를 제안한다. OCC나 CCL을 단독으로 적용할 경우 carrier 증폭기의 출력 임피던스가 하나의 값으로 결정된다. 반면, OCC와 CCL을 함께 적용하면 carrier 증폭기의 출력 임피던스를 선택할 수 있게 되어 회로 설계에 자유도가 생긴다. 제작된 DPA는 carrier 증폭기의 load impedance 변조비를 기존의 2배에서 5배로 확장하여 확장된 back-off 영역을 얻었다. 제작된 DPA는 3.7~4.0 GHz에서 CW 신호를 이용하여 43.0~44.3 dBm의 출력전력, 8.0~8.5 dB의 gain을 얻었다. Peak power에서 72.5~77.9 %의 DE, 9 dB OBO에서 41.5~48.4 %의 DE를 얻었다. 7.8 dB의 PAPR(peak-to-average power ratio)을 갖는 5G NR 100 MHz 64-QAM OFDM 신호를 이용하여 8.2~8.7 dB의 gain과 9 dB OBO에서 45.6~50.0 %의 DE, −22.0~−26.6 dBc의 ACLR을 얻었다.

Abstract

This paper proposes a Doherty power amplifier (DPA) with an extended output power back-off (OBO) using out-phased current combining (OCC) and complex combining load (CCL) methods. When OCC or CCL is applied independently, the output impedance of the carrier amplifier is determined to be a single value. However, when OCC and CCL are applied together, the output impedance of the carrier amplifier can be selected, which provides freedom in the circuit design. The implemented DPA achieves an extended back-off region by expanding the load impedance modulation ratio of the carrier amplifier by five times between the low-power and peak-power levels. The implemented DPA achieves 43.0~44.3 dBm output power and 8.0~8.5 dB gain using a CW signal at 3.7~4.0 GHz. It achieves 72.5~77.9 % DE at peak power and 41.5~48.4 % DE at 9 dB OBO. Furthermore, it achieves 8.2~8.7 dB of gain, 45.6~50.0 % DE at 9 dB OBO, and an ACLR of −22.0~−26.6 dBc using a 100 MHz 64-QAM 5G NR modulated signal with a peak-to-average power ratio (PAPR) of 7.8 dB.

Keywords: Out-Phased Current Combining; Complex Combing Load; Doherty Power Amplifier; Extended Output Back-Off

I. 서 론

무선통신이 발전함에 따라 변조 신호의 높은 PAPR (peak-to-average power ratio)로 인해 전력증폭기의 평균 출력전력에서의 효율이 중요해지고 있다. 따라서 output power back-off 영역에서의 효율을 높이기 위해 DPA (Doherty power amplifier)가 사용되고 있다[1]~[17]. 기본적인 구조의 DPA는 6 dB의 OBO(output power back-off)를 가진다. PAPR이 증가함에 따라 더 확장된 OBO에서 증폭기 효율의 개선이 필요하다. 더 확장된 OBO를 가지기 위해 asymmetric DPA, CCL(complex combing load), VS(virtual stub), OCC(out-phased current combining)와 같은 연구들이 진행되고 있다[3]~[17].

그 중 OCC은 높은 출력 전력에서 전력 결합 node에서 carrier 증폭기와 peaking 증폭기의 출력 전류의 위상 차이를 조절함으로써 OBO 영역을 확장하는 방식이다. CCL은 증폭기 부하 임피던스에 허수부 성분을 도입함으로써 OBO 영역을 확장하는 방식이다.

본 논문에서는 Cree사의 GaN-HEMT 소자인 CG2H40010F 를 사용하여 DPA를 설계하였다. OBO 영역을 확장하기 위해 OCC와 CCL을 함께 적용하여 전력 결합 node에서의 impedance가 허수부를 가지며, carrier 증폭기와 peaking 증폭기의 전류가 위상 차이를 가지도록 설계하였다.

Ⅱ. 제안하는 Doherty 전력증폭기

9 dB의 OBO를 얻기 위한 설계 파라미터들은 참고문헌 [14]의 수식을 이용하여 구할 수 있다. 먼저, 식 (1)에서 k는 carrier amp의 low power와 peak power에서의 전력비다.

k   =   P C , p e a k P C , l o w .
(1)

Carrier 증폭기의 low power와 peak power에서의 전력비를 이용하여 symmetric DPA의 OBO를 식 (2)와 같이 구할 수 있다.

O B O d B   =   10   × log 2 k .
(2)

Coventional DPA의 k는 2로 6 dB의 OBO를 가진다. OBO를 확장하기 위해선, 더 큰 k를 가져야 한다.

Q L   =   B L G L ,
(3)
Q P O   =   B P O G L .
(4)

GL과 BL은 그림 1에서 admittance YL의 conductance와 susceptance이다. BPO는 low power에서 peaking amplifier의 admittance인 YPO의 susceptance이다. QL과 QPO는 각각 combining load와 peaking amplifier에 대한 설계 파라미터로 식 (3) 및 식 (4)와 같이 정의한다.

Y C , p e a k   =   G L 1 β   +   1 + j Q L + Q P O + a b ,
(5)
Y P , p e a k   =   G L β β   +   1 − j Q P O + a b .
(6)

YC,peak와 YP,peak는 그림 1에서 peak power에서의 carrier 증폭기와 peaking 증폭기의 load admittance로 식 (5) 및 식 (6)과 같다.

Y C , l o w   =   G L 1   +   j Q L + Q P O ,
(7)
Y P O   =   j G L Q P O .
(8)
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그림 1. | Fig. 1. 단순화한 DPA의 출력 네트워크 | Simplified load network of DPA.
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YC,low는 그림 1에서 low power에서 carrier 증폭기의 load admittance로 식 (7)과 같다. YPO는 그림 1에서 low power에서 carrier 증폭기의 load admittance로 식 (7)과 같다.

I m Z C , p e a k R e Z C , p e a k   =   I m Z P , p e a k R e Z P , p e a k ,
(9)
I m Z L   =   0 ,   w / o   C C L .
(10)

OCC를 사용할 경우 식 (9)와 같이 peak power에서 ZC,peak와 ZP,peak의 실수부와 허수부의 비율이 같아야 한다[16]. CCL을 사용할 경우와 식 (10)와 같이 ZL이 허수부를 가지게 된다[9].

c   =   − 5 4 + 1 2 k + 1 k .
(11)

c가 식 (11)과 같이 정의될 때 식 (5)~식 (8)이 식 (9) 및 식 (10)을 만족시키기 위해선 QL과 QPO가 표 1의 값을 가진다. RL이 결정되면 OCC나 CCL을 단독 사용하는 경우 QL과 QPO가 하나의 값으로 결정되어 출력 네트워크의 임피던스들이 각각 하나의 값으로 결정된다. 이 경우 결정된 임피던스들을 이용하여 설계할 경우 네트워크 설계가 복잡해질 수 있다. 하지만, OCC와 CCL을 함께 사용할 경우 QL을 특정 범위 내에서 적절하게 선택할 수 있어 네트워크 설계의 자유도가 생기게 된다.

표 1. | Table 1. 설계 파라미터 | Design parameters.
Combination QL QPO
OCC 0 0
CCL −2 c 0
OCC+CCL (−3 c, 0) 0
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그림 2는 표 1의 설계 파라미터를 이용하여 low power와 peak power에서의 carrier 증폭기의 load impedance를 smith chart에 표현한 것이다. OCC와 CCL을 함께 사용할 경우 네트워크 설계를 고려하며 적절한 QL을 선택하여 작은 Q circle 안에서 carrier network의 임피던스 변환이 되도록 할 수 있다.

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그림 2. | Fig. 2. 낮은 전력과 피크 전력에서 carrier 증폭기 출력 네트워크의 임피던스(RC,opt×kRC,opt)에 의해 정규화) | Load impedances of carrier amplifier in low power and peak power (normalized by RC,opt×kRC,opt).
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그림 3에서 RC,opt와 RP,opt는 load-pull simulation을 통해 찾은 carrier 증폭기와 peaking 증폭기의 최적 impedance이다. Load-pull simulation을 통해 RC,opt와 RP,opt를 각각 16 Ω으로 결정하였다. 식 (2)를 이용하여 10 dB의 확장된 OBO를 얻기 위해 k의 값은 5로 선택하였다. QL을 −0.667 c로 설정하여 low power와 peak power에서의 load impedance가 작은 Q circle 안에 있도록 하였다. 이때 carrier 증폭기와 peaking 증폭기의 low power와 peak power에서의 load impedance를 그림 3과 같이 구하였다.

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그림 3. | Fig. 3. 제안하는 DPA의 출력 네트워크 | Load network of the proposed DPA.
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Ⅲ. 설계 및 측정

Carrier 증폭기의 경우 low power에서 ZC,low에서 RC,opt로 impedance matching이 되고, peak power에서 ZC,peak에서 kRC,opt로 impedance matching되는 carrier load network를 설계하였다.

Peaking 증폭기의 경우 ZP,peak에서 RP,opt로 impedance matching이 되고 동시에 ZPO가 open(∞)이 되는 peaking load network를 설계하였다.

그림 4는 본 논문에서 설계한 DPA의 전체 회로도와 제작된 DPA를 보여준다. Carrier 증폭기와 peaking 증폭기 모두 Cree의 GaN-HEMT CG2H40010F를 사용하였다. 입력 신호는 50 Ω에서 30 Ω으로 임피던스 변환하는 Wilkinson Power Divider를 통해 동일하게 분배된다. Carrier 증폭기와 peaking 증폭기 모두 같은 구조의 입력단의 회로를 사용하였으며, 입력 회로 앞 단에 offset line을 사용하여 출력 전류의 위상 차이를 조절하였다.

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그림 4. | Fig. 4. 설계한 DPA의 전체 회로도 | Overall schematic of the designed DPA.
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그림 5는 제작된 DPA의 사진이다. PCB는 Rogers RO4350B가 사용되었다. 전체 회로의 크기는 7.1×6.0 cm2이다. Carrier 증폭기와 peaking 증폭기의 gate voltage는 각각 −2.9 V와 −7 V가 사용되었고, drain voltage는 하나의 drain bias 회로를 통해 28 V가 인가되었다.

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그림 5. | Fig. 5. 제작된 DPA의 사진 | Photograph of the implemented DPA.
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그림 6은 3.7~4.0 GHz 대역에서 CW 신호를 이용하여 측정한 제작된 DPA의 gain과 DE를 나타낸다. 제작된 DPA는 43.0~44.3 dBm의 peak power, 8.0~8.5 dB의 gain을 얻었다. 또한, peak power에서 72.5~77.9 %의 DE, 9 dB OBO에서 41.5~48.4 %의 DE를 얻었다.

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그림 6. | Fig. 6. 3.7~4.0 GHz 대역에서 CW 신호를 이용하여 측정한 제작된 DPA의 성능 | Measured performances using a CW signal for the frequency band 3.7~4.0 GHz.
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그림 7은 7.8 dB의 PAPR을 갖는 5G NR 100 MHz 64-QAM OFDM 신호를 이용하여 측정한 제작된 DPA의 gain, DE와 ACLR 성능을 나타낸다. 제작된 DPA는 3.7~4.0 GHz 대역에서 8.2~8.7 dB의 gain과 9 dB OBO에서 45.6~50.0 %의 DE를 얻었고, 9 dB OBO에서 −22.0~−26.6 dBc의 ACLR을 얻었다.

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그림 7. | Fig. 7. 7.8 dB의 PAPR을 갖는 5G NR 100 MHz 64-QAM OFDM 신호를 이용하여 측정한 제작된 DPA의 성능 | Measured performances of the implemented DPA using a 5G NR 100 MHz 64-QAM OFDM with a PAPR of 7.8 dB.
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그림 8은 중심주파수 3.85 GHz, 9 dB OBO에서 앞서 사용한 5G NR 신호를 이용하여 측정한 DPD(digital pre-distortion) 기법을 적용하기 전과 후의 스펙트럼이다. DPD 기법 적용 이후 ACLR은 −24 dBc에서 −49 dBc로 개선되었다.

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그림 8. | Fig. 8. 5G NR 신호를 이용하여 측정한 DPD 전/후 스펙트럼 | Measured spectrum using the 5G NR signal before and after DPD.
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표 2에 제안된 DPA의 측정 결과와 OCC나 CCL을 단독으로 적용한 이전의 연구 결과들의 성능비교를 정리하였다. 제안된 전력증폭기가 이전의 연구 결과들과 비교하여 넓은 주파수 대역에서 확장된 OBO를 가진다.

표 2. | Table 2. 이전에 보고된 DPA와 성능 비교 | Performance comparison with the previous works.
Ref. Freq. (GHz) Topology Psat (dBm) DEsat (%) OBO (dB) DEOBO (%)
[8] 1.68 CCL 43.5 73.9 9.5 56.4
[11] 3.5~3.6 CCL 42~43 60~64.7 7~8 48~48.5
[16] 2.1~2.3 OCC 43.6 69~71 9 40~54
[17] 3.3 OCC 42.3 76.9 9 59.6
This work 3.7~4.0 OCC+CCL 43.0~44.3 72.5~77.9 9 41.5~48.4
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Ⅳ. 결 론

본 논문에서는 OCC와 CCL을 함께 적용하여 확장된 OBO를 가지는 DPA를 설계하였다. OCC나 CCL을 단독으로 적용할 경우 출력 네트워크의 임피던스들이 각각 하나의 값으로 결정된다. 반면, OCC와 CCL을 함께 적용하면 출력 네트워크의 임피던스들을 선택할 수 있게 되어 회로 설계에 자유도가 생긴다. 제작된 DPA는 3.7~4.0 GHz에서 CW를 이용하여 43.0~44.3 dBm의 출력전력, 8.0~8.5 dB의 gain을 얻었다. Peak power에서 72.5~77.9 %의 DE, 9 dB OBO에서 41.5~48.4 %의 DE를 얻었다. 7.8 dB의 PAPR을 갖는 5G NR 100 MHz 64-QAM OFDM 신호를 이용하여 8.2~8.7 dB의 gain과 9 dB OBO에서 45.6~50.0 %의 DE, −22.0~−26.6 dBc의 ACLR을 얻었다.

Acknowledgements

이 연구는 2023학년도 산업통상자원부 및 산업기술평가관리원(KEIT) 연구비 지원에 의한 연구임(20017971).

References

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Author Information

최 재 혁 [성균관대학교/석사과정]

jkiees-34-11-791-i1

  • https://orcid.org/0000-0002-4835-0400

  • 2022년 2월: 성균관대학교 전자전기공학부 (공학사)

  • 2022년 3월~현재: 성균관대학교 전자전기컴퓨터공학과 석사과정

  • [주 관심분야] RF/mm-Wave Power Amplifier, Linearization and Efficiency Enhancement Techniques

진 일 비 [성균관대학교/석․박사통합과정]

jkiees-34-11-791-i2

  • https://orcid.org/0000-0003-2030-3351

  • 2018년 8월: 고려대학교 전자공학과 (공학사)

  • 2018년 9월~현재: 성균관대학교 전자전기컴퓨터공학과 석․박사통합과정

  • [주 관심분야] RF/mm-Wave Power Amplifier, Linearization and Efficiency Enhancement Techniques

김 성 형 [성균관대학교/석사과정]

jkiees-34-11-791-i3

  • https://orcid.org/0009-0004-4973-4360

  • 2022년 2월: 성균관대학교 전자전기공학과 (공학사)

  • 2022년 3월~현재: 성균관대학교 전자전기컴퓨터공학과 석사과정

  • [주 관심분야] RF/mm-Wave Power Amplifier, Linearization and Efficiency Enhancement Techniques

송 재 성 [성균관대학교/석사과정]

jkiees-34-11-791-i4

  • https://orcid.org/0009-0009-4095-7687

  • 2023년 2월: 수원대학교 전자공학과 (공학사)

  • 2023년 3월~현재: 성균관대학교 전자전기컴퓨터공학과 석사과정

  • [주 관심분야] RF/mm-Wave Power Amplifier, Linearization and Efficiency Enhancement Techniques

이 윤 정 [성균관대학교/석․박사통합과정]

jkiees-34-11-791-i5

  • https://orcid.org/0009-0001-7373-6065

  • 2023년 2월: 경희대학교 전자공학과 (공학사)

  • 2023년 3월~현재: 성균관대학교 전자전기컴퓨터공학과 석사․박사통합과정

  • [주 관심분야] RF Power Amplifier, Rectifier, MMIC, Wireless Power Transfer System

임 서 균 [성균관대학교/석사과정]

jkiees-34-11-791-i6

  • https://orcid.org/0009-0009-1456-6009

  • 2020년 2월: 성균관대학교 전자전기공학부(공학사)

  • 2023년 9월~현재: 성균관대학교 전자전기컴퓨터공학과 석사과정

  • [주 관심분야] RF/mm-Wave Power Amplifier, Low Noise Amplifier, Linearization and Efficiency Enhancement Techniques

양 영 구 [성균관대학교/교수]

jkiees-34-11-791-i7

  • https://orcid.org/0000-0003-3463-0687

  • 1997년 2월: 한양대학교 전자공학과 (공학사)

  • 2002년 2월: 포항공과대학교 전자전기공학과 (공학박사)

  • 2002년 3월~2002년 7월: 포항공과대학교 전자전기공학과 박사후 연구원

  • 2002년 8월~2005년 2월: Skyworks Solutions Inc., Senior Electronic Engineer

  • 2005년 3월~현재: 성균관대학교 전자전기컴퓨터공학과 교수

  • [주 관심분야] 초고주파 회로설계, 무선통신 송/수신기 시스템 설계, 비선형 회로 분석 및 시뮬레이션 기법 연구


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